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      飛利浦－大唐筆試題
      
            
      
                時間：2024-07-31 05:07:13 
                
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      飛利浦－大唐筆試題
      
                

      　　1、用邏輯們和cmos電路實現ab+cd

      　　2、用一個二選一mux和一個inv實現異或

      　　3、給了reg的setup,hold時間，求中間組合邏輯的delay范圍。

      　　4. 如何解決亞穩態

      　　5. 用verilog/vhdl寫一個fifo控制器

      　　6. 用verilog/vddl檢測stream中的特定字符串
      飛利浦－大唐筆試題
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