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      基于FPGA的RISC8位單片機設計

      時間:2024-07-23 07:27:52 通信工程畢業論文 我要投稿
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      基于FPGA的RISC8位單片機設計

      全部作者: 周啟民 楊福寶 第1作者單位: 武漢理工大學 信息工程學院 論文摘要: 本文基于FPGA和RISC的技術,用Verilog HDL語言設計了1個8位單片機,在QuartusⅡ下進行軟件仿真,并在硬件上得到應用。這個處理器解決了目前常用嵌入式處理器的指令復雜、執行時間長、執行效率低且硬件框架固定不可根據工程應用修改的缺陷。 關鍵詞:RISC、FPGA、Verilog HDL、8位單片機 關鍵詞: RISC,FPGA,Verilog HDL,8位單片機 (瀏覽全文) 發表日期: 2008年01月18日 同行評議:

      1.摘要中對嵌入式單片機缺點的評價并不貼切。軟核的嵌入式單片機已經得到廣泛的工程應用。2. 論文缺乏說明為什么必須是分作8個部分,與目前通行的RISC單片機的劃分有何不同,如果是相同,那本文的單片機的優特點又是如何體現的?3.本文的單片機共設計了多少條指令?最終實現了多少條指令?是否通過什么公認的測試手段說明設計是有效的?對液晶YM12864的控制用到了多少條指令?4.為什么只有程序控制器模塊的結果?5. 本文單片機的優點是通過與現有那類單片機比較后得出的?比較的數據? 

      綜合評價: 修改稿: 注:同行評議是由特聘的同行專家給出的評審意見,綜合評價是綜合專家對論文各要素的評議得出的數值,以1至5顆星顯示。

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